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fpga本来就是用作仿真原始硬件电路的，理论上可以无限接近实机，但也只是理论上，这么多机种五花八门的元器件，要做到100%门级别仿真哪有那么容易，而且不少人说mister的很多核心代码属于行为级仿真，那就跟实机差的远了，相对于软件模拟器也就只有延迟方面的优势。本人不懂verilog语言，专业的可以去看看。

引用:

原帖由 君思睿 于 2023-4-22 11:25 发表
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如果从仿真级别看FPGA就觉得不如软件模拟器，这就是个天大的误解了，哪怕是行为级也是比软件模拟器强的，理解这个其实很简单。

游戏机内部有N个芯片，他们都是并行工作的，FPG ...

是的，因为fpga可以流水线并行和数据并行，延迟天生会比cpu和gpu低，理论上即使是行为级仿真也比软件模拟器表现更精确。但如果仅是这样意义还不够大，要尽量往门级仿真方向努力，才能从物理层面无限的接近实机。mister也在频繁的更新，希望neogeo核心如你说的那样，无限接近基板的效果。

网上查到的RTL行为级仿真和门级仿真的区别，作为门外汉也只能理解到这种程度了
RTL仿真 VS. 门级仿真
第一阶段具体的仿真对象就是在设计阶段得到的RTL代码。需要说明的是，RTL（register transfer level），顾名思义，是用寄存器传输级的描述方式，描述数字电路的数据流。
可以认为RTL是一种中间状态，后面我们会通过其他综合工具，将RTL映射到某种工艺库（通常我们所说的40nm\7nm工艺等等），生成对应工艺库下的门级网标。
在RTL仿真阶段，数据在传输过程中，是在一种理想状态下，即信号在传输过程中没有延时，并且数字信号从0-1或者1-0的跳变过程，瞬间完成。
但是我们都知道，在实际的电路中，情况并非如此。
在真实的芯片中，延时有线延时以及门延时。为了得到更可靠、更真实的仿真仿真结果，除了对RTL进行仿真之外，我们会在综合完成之后，进行第二阶段的仿真，即对生成的门级网标再次进行仿真。
进行门级仿真主要有两个目的：
保证RTL与门级网标的一致性。在合成过程中，综合工具为了满足约束条件，会进行优化，所以会出现merge和removal的情况。虽然有专门的一致性比对工具，进行门级网标和RTL的对比，但是门级网标仿真同样重要。在门级仿真过程中，会加入延时文件，模拟线延时和门延时，得到更加可靠的仿真结果。两种功能仿真的对比
RTL仿真速度快，但是真实性稍微欠缺。门级仿真速度慢，但是更加接近于芯片真实的工作状态。
两者互相补充，确保仿真的速度和真实性。

引用:

原帖由 剑二十三 于 2023-4-24 09:34 发表



因为我入了analogue pocket啊！！！

作为器材党还不得吹爆！


我表达的意思是

FPGA并不是魔术，使用FPGA并不能自动保证准确或有趣的体验。需要有才华的工程师花大量的时间对游戏系统进行逆向工程，弄 ...

对头，只能说fpga的上限是很高的，如果能100%做到门极仿真，理论上就能无限接近实机的物理电路和元器件层，但是谈何容易，目前mister核心还在不断频繁的更新，说明离100%还差的远吧